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中央处理器（Central Processing Unit）的缩写 ，即CPU，CPU是电脑中的核心配件 ，只有火柴盒那么大 ，几十张纸那么厚，但它却是一台计算机的运算核心和控制核心 。电脑中所有操作都由CPU负责读取指令 ，对指令译码并执行指令的核心部件 。CPU的主要运作原理 ，不论其外观，都是执行储存于被称为程式里的一系列指令。在此讨论的是遵循普遍的架构设计的装置 。程式以一系列数字储存在电脑记忆体中 。差不多所有的CPU的运作原理可分为四个阶段：提取（Fetch）、解码（Decode） 、执行（Execute）和写回（Writeback）。 Intel公司生产的Core牌CPU第一阶段 ，提取 ，从程式记忆体中检索指令（为数值或一系列数值） 。由程式计数器（Program Counter）指定程式记忆体的位置，程式计数器保存供识别目前程式位置的数值 。换言之 ，程式计数器记录了CPU在目前程式里的踪迹。 提取指令之后 ，程式计数器根据指令式长度增加记忆体单元 。指令的提取常常必须从相对较慢的记忆体寻找，导致CPU等候指令的送入 。这个问题主要被论及在现代处理器的快取和管线化架构（见下）。 CPU根据从记忆体提取到的指令来决定其执行行为 。在解码阶段，指令被拆解为有意义的片断 。根据CPU的指令集架构（ISA）定义将数值解译为指令。 一部分的指令数值为运算码（Opcode） ，其指示要进行哪些运算。其它的数值通常供给指令必要的资讯 ，诸如一个加法（Addition）运算的运算目标 。这样的运算目标也许提供一个常数值（即立即值），或是一个空间的定址值：暂存器或记忆体位址 ，以定址模式决定 。 在旧的设计中 ，CPU里的指令解码部分是无法改变的硬体装置。不过在众多抽象且复杂的CPU和指令集架构中，一个微程式时常用来帮助转换指令为各种形态的讯号 。这些微程式在已成品的CPU中往往可以重写 ，方便变更解码指令 。 在提取和解码阶段之后 ，接着进入执行阶段。该阶段中，连接到各种能够进行所需运算的CPU部件 。 例如 ，要求一个加法运算 ，算数逻辑单元（ALU，Arithmetic Logic Unit）将会连接到一组输入和一组输出 。输入提供了要相加的数值 ，而且在输出将含有总和结果。ALU内含电路系统 ，以于输出端完成简单的普通运算和逻辑运算（比如加法和位元运算） 。如果加法运算产生一个对该CPU处理而言过大的结果，在标志暂存器里，运算溢出（Arithmetic Overflow）标志可能会被设置（参见以下的数值精度探讨） 。 最终阶段 ，写回 ，以一定格式将执行阶段的结果简单的写回。运算结果极常被写进CPU内部的暂存器，以供随后指令快速存取 。在其它案例中 ，运算结果可能写进速度较慢 ，但容量较大且较便宜的主记忆体 。某些类型的指令会操作程式计数器，而不直接产生结果资料。这些一般称作“跳转”（Jumps）并在程式中带来循环行为 、条件性执行（透过条件跳转）和函式。 许多指令也会改变标志暂存器的状态位元 。这些标志可用来影响程式行为 ，缘由于它们时常显出各种运算结果 。 例如 ，以一个“比较 ”指令判断两个值的大小，根据比较结果在标志暂存器上设置一个数值。这个标志可藉由随后的跳转指令来决定程式动向 。 在执行指令并写回结果资料之后 ，程式计数器的值会递增 ，反覆整个过程，下一个指令周期正常的提取下一个顺序指令 。如果完成的是跳转指令 ，程式计数器将会修改成跳转到的指令位址 ，且程式继续正常执行。许多复杂的CPU可以一次提取多个指令、解码，并且同时执行 。这个部分一般涉及“经典RISC管线 ”，那些实际上是在众多使用简单CPU的电子装置中快速普及（常称为微控制（Microcontrollers）） 。
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中央处理器（Central Processing Unit）的缩写 ，即CPU ，CPU是电脑中的核心配件，只有火柴盒那么大 ，几十张纸那么厚 ，但它却是一台计算机的运算核心和控制核心。电脑中所有操作都由CPU负责读取指令，对指令译码并执行指令的核心部件 。CPU的主要运作原理 ，不论其外观 ，都是执行储存于被称为程式里的一系列指令 。在此讨论的是遵循普遍的架构设计的装置。程式以一系列数字储存在电脑记忆体中 。差不多所有的CPU的运作原理可分为四个阶段：提取（Fetch） 、解码（Decode） 、执行（Execute）和写回（Writeback） 。 Intel公司生产的Core牌CPU第一阶段，提取 ，从程式记忆体中检索指令（为数值或一系列数值）。由程式计数器（Program Counter）指定程式记忆体的位置 ，程式计数器保存供识别目前程式位置的数值。换言之，程式计数器记录了CPU在目前程式里的踪迹 。 提取指令之后 ，程式计数器根据指令式长度增加记忆体单元 。指令的提取常常必须从相对较慢的记忆体寻找 ，导致CPU等候指令的送入。这个问题主要被论及在现代处理器的快取和管线化架构（见下） 。 CPU根据从记忆体提取到的指令来决定其执行行为 。在解码阶段，指令被拆解为有意义的片断。根据CPU的指令集架构（ISA）定义将数值解译为指令 。 一部分的指令数值为运算码（Opcode），其指示要进行哪些运算 。其它的数值通常供给指令必要的资讯 ，诸如一个加法（Addition）运算的运算目标。这样的运算目标也许提供一个常数值（即立即值） ，或是一个空间的定址值：暂存器或记忆体位址，以定址模式决定 。 在旧的设计中 ，CPU里的指令解码部分是无法改变的硬体装置 。不过在众多抽象且复杂的CPU和指令集架构中 ，一个微程式时常用来帮助转换指令为各种形态的讯号。这些微程式在已成品的CPU中往往可以重写，方便变更解码指令 。 在提取和解码阶段之后 ，接着进入执行阶段 。该阶段中 ，连接到各种能够进行所需运算的CPU部件。 例如，要求一个加法运算 ，算数逻辑单元（ALU ，Arithmetic Logic Unit）将会连接到一组输入和一组输出。输入提供了要相加的数值，而且在输出将含有总和结果 。ALU内含电路系统 ，以于输出端完成简单的普通运算和逻辑运算（比如加法和位元运算） 。如果加法运算产生一个对该CPU处理而言过大的结果 ，在标志暂存器里，运算溢出（Arithmetic Overflow）标志可能会被设置（参见以下的数值精度探讨）。 最终阶段，写回 ，以一定格式将执行阶段的结果简单的写回 。运算结果极常被写进CPU内部的暂存器 ，以供随后指令快速存取 。在其它案例中，运算结果可能写进速度较慢 ，但容量较大且较便宜的主记忆体。某些类型的指令会操作程式计数器 ，而不直接产生结果资料 。这些一般称作“跳转”（Jumps）并在程式中带来循环行为、条件性执行（透过条件跳转）和函式 。 许多指令也会改变标志暂存器的状态位元。这些标志可用来影响程式行为，缘由于它们时常显出各种运算结果 。 例如 ，以一个“比较 ”指令判断两个值的大小 ，根据比较结果在标志暂存器上设置一个数值 。这个标志可藉由随后的跳转指令来决定程式动向。 在执行指令并写回结果资料之后，程式计数器的值会递增 ，反覆整个过程 ，下一个指令周期正常的提取下一个顺序指令 。如果完成的是跳转指令，程式计数器将会修改成跳转到的指令位址 ，且程式继续正常执行 。许多复杂的CPU可以一次提取多个指令 、解码 ，并且同时执行。这个部分一般涉及“经典RISC管线 ”，那些实际上是在众多使用简单CPU的电子装置中快速普及（常称为微控制（Microcontrollers））。
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